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J-GLOBAL ID：200903058918457333
半導体装置の製造方法
Inventor：
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Applicant, Patent owner：
Agent (1)：
杉村 暁秀 (外5名)
Gazette classification：公開公報
Application number (International application number)：1994228151
Publication number (International publication number)：1995153832
Application date： Sep. 22, 1994
Publication date： Jun. 16, 1995
Summary：
【要約】【目的】 導電体のパターンの形成により、導電体相互の短絡が生じるのを防止する。【構成】 絶縁材料13が充填された溝10,24より成るフィールド絶縁領域14を有する半導体本体1を具える半導体装置を製造するに当り、半導体本体1の表面5上に設けた補助層6上に形成したエッチングマスク9を用いて溝10,24を半導体本体内にエッチング形成するものであり、補助層6は、溝を形成する前にエッチングマスク9に隣接して位置する表面5の一部分11から除去するとともに溝を形成した後にエッチングマスク9の下側に位置する表面5の縁部12から除去する。
Claim (excerpt)：
絶縁材料が充填された溝より成るフィールド絶縁領域を有する半導体本体を具える半導体装置を製造するに当り、前記の半導体本体の表面上に設けた補助層上に形成したエッチングマスクを用いて前記の溝を半導体中にエッチング形成し、前記の補助層を前記のエッチングマスクに隣接して位置する表面の一部分から且つ前記のエッチングマスクの下側に位置する表面の縁部から除去し、絶縁材料の層を半導体本体上に堆積し、この絶縁材料により前記の溝を充填するとともに前記のエッチングマスクの下側に位置する前記の表面の縁部を被覆し、その後半導体本体を処理してこの処理により材料を前記の補助層に至るまで前記の表面に平行に除去し、次に補助層の残存部分を除去する半導体装置の製造方法において、前記の溝を半導体本体中にエッチング形成する前に、前記のエッチングマスクに隣接して位置する前記の表面の一部分から前記の補助層を除去し、前記の溝を半導体本体中にエッチング形成した後に、前記のエッチングマスクの下側に位置する表面の縁部から前記の補助層を除去することを特徴とする半導体装置の製造方法。
IPC (2)：
FI (2)：
H01L 21/76 L
, H01L 21/94 Z
Cited by applicant (1)
Cited by examiner (6)
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