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J-GLOBAL ID:201702238262766148   整理番号:17A0062273

CSRE検出器システムの容量性負荷遮断回路設計【JST・京大機械翻訳】

Capacitive - Load Isolation Techniques in Timing Detector of CSRe Internal Target
著者 (6件):
資料名:
巻: 36  号:ページ: 448-452  発行年: 2016年 
JST資料番号: C2038A  ISSN: 0258-0934  CODEN: HDYUEC  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
抄録/ポイント:
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タイミング駆動回路の容量負荷によって引き起こされるオーバシュートとリンギングの問題を解決するために,容量分離技術を採用して,回路の利得と帯域幅に影響を及ぼさずに,一定の容量負荷容量を持って,安定性を向上させることができた。回路モデルを構築することによって,回路の不安定性の原因を数学的観点から解析して,容量負荷分離技術の合理性を実験によって証明した。容量性負荷分離技術は容量性負荷回路によってもたらされる利得と周波数応答を効果的に除去することができる。Data from the ScienceChina, LCAS. Translated by JST【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
著者キーワード (3件):
分類 (3件):
分類
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半導体集積回路  ,  光導電素子  ,  増幅回路 
タイトルに関連する用語 (4件):
タイトルに関連する用語
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