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J-GLOBAL ID:201002245781269528   整理番号:10A0057009

最近のSAT技術の発展 SATによるシステム検証

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巻: 25  号:ページ: 122-129  発行年: 2010年01月01日 
JST資料番号: X0330A  ISSN: 0912-8085  資料種別: 逐次刊行物 (A)
記事区分: 解説  発行国: 日本 (JPN)  言語: 日本語 (JA)
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命題論理の充足可能性判定(SAT)問題を解くSATソルバーが飛躍的に向上し,ハードウェア・ソフトウェアの信頼性を高めるためのシステム検証への応用が試みられている。本論文では,SAT技術を用いたモデル検査手法の1つである有界モデル検査(BMC),及びソフトウェア・ハードウェアのテスト手法の1つである組合せテストについて述べた。BMCは与えられた安全性や活性を表すLTL(Linear Temporal Logic)の論理式から性質の否定命題を構成し,連言標準形に変換してSATソルバーに入力して性質の反例を探す不完全な手続きである。そこで,性質の証明を得る方法として帰納法を用いる方法を説明した。また,組合せテスト手法としてはk個の2値入力を持つ回路において任意のt(t<k)個の入力に対し,必要となるテストケース数の最小値を求める被覆配列の構成問題を解説した。前記問題は制約充足問題として定式化できるのでSAT符号化を用い,SATを用いたテストケース自動生成に関する実験結果を紹介した。
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分類 (3件):
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論理代数  ,  計算理論  ,  その他のオペレーションズリサーチの手法 
引用文献 (31件):
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