研究者
J-GLOBAL ID:200901027626254962
更新日: 2024年01月31日
小野寺 秀俊
オノデラ ヒデトシ | Onodera Hidetoshi
所属機関・部署:
職名:
教授
研究キーワード (2件):
集積回路工学
, Integrated Circuits Technology
競争的資金等の研究課題 (38件):
- 2017 - 2020 IoT社会の実現を目指した次世代コンピューティング基盤の研究
- 2016 - 2020 自律的に最小エネルギー動作を実現する集積回路設計技術
- 2014 - 2017 環境発電技術を用いた社会に溶け込むコンピューティング基盤の研究
- 2013 - 2017 自律的特性補償により閾値付近の低電圧まで安定動作する集積回路設計技術
- 2010 - 2012 低電圧安定動作を実現する集積回路ハードウェア設計技術
- 2007 - 2009 ばらつきや欠陥を克服する集積回路ハードウェア設計技術
- 2002 - 2004 集積回路における高速信号伝送技術の研究
- 2001 - 2002 動き補償を利用した動画像の実時間背景・対象物分離アルゴリズムとハードウエアの開発
- 1999 - 2001 エネルギー回復型低消費電力プロセッサーアーキテクチャの開発
- 1999 - 2001 大規模集積回路の統計的特性解析・最適化手法の開発
- 1998 - 2000 低ビットレート・マルチメディア伝送を行う機能素子LSIの開発
- 1998 - 1999 実時間動き補償用メモリ混載型低消費電力プロセッサの開発
- 1997 - 1998 超微細構造集積回路の詳細設計最適化手法
- 1996 - 1997 VLSIシステム設計教育カリキュラムの開発
- 1996 - 1997 微細MOSFET統計的モデル化手法の開発
- 1995 - 1997 機能メモリ型並列プロセッサを用いた計算機システムの開発
- 1994 - 1995 回路特性制約を考慮したアナログ回路の素子値/レイアウト同時設計法の研究
- 1994 - 1995 情報科学のための教育用マイクロプロセッサシステムの開発
- 1994 - 1995 LSI設計CAD評価用総合ベンチマークセットの開発
- 1993 - 1995 設計方法の獲得・再利用化による効率的なアナログLSI設計手法に関する研究
- 1992 - 1994 LSIレイアウト図形処理専用計算機の開発
- 1992 - 1993 計算機工学・集積回路工学教育研究用マイクロプロセッサの開発
- 1990 - 1992 機能メモリ型並列プロセサアーキテクチャとそれを用いた超並列アルゴリズムの研究
- 1990 - 1991 集積回路設計における高位レベル情報抽出に関する研究
- 1989 - 1991 アナログーディジタル統合CADシステムの開発
- 1988 - 1990 新しい超高速変調・復調光通信システムに関する基礎研究
- 1989 - 1989 アナログ基本モジュールの設計自動化に関する研究
- 1987 - 1988 階層的アナログ回路LSI設計CADシステムの研究
- 1987 - 1987 MOS集積化循環型高速A-D,D-A変換回路の研究
- 1985 - 1987 レーザーの同期結合を用いた光増幅に関する基礎研究
- 1986 - 1986 MOS集積化能動RCフィルタ回路の研究
- 1985 - 1985 MOS FET モデルパラメータの最適抽出に関する研究
- ディジタル回路設計技術
- アナログ回路設計技術
- 集積回路の計算機援用設計法
- Digital Circuit Design Technique
- Analog Circuit Design Technique
- Computer-Aided Design for Integrated Circuits
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論文 (620件):
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Shoya SONODA, Jun SHIOMI, Hidetoshi ONODERA. Approximation-Based System Implementation for Real-Time Minimum Energy Point Tracking over a Wide Operating Performance Region. IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences. 2023. E106.A. 3. 542-550
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Masanori Hashimoto, Xu Bai, Naoki Banno, Munehiro Tada, Toshitsugu Sakamoto, Jaehoon Yu, Ryutaro Doi, Hidetoshi Onodera, Takashi Imagawa, Hiroyuki Ochi, et al. Via-switch FPGA with transistor-free programmability enabling energy-efficient near-memory parallel computation. Japanese Journal of Applied Physics. 2022. 61. SM. SM0804-SM0804
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Misaki Udo, Mahfuzul Islam, Hidetoshi Onodera. Homogeneous Ring Oscillator with Staggered Layout for Gate-level Delay Characterization. IEEE International Conference on Microelectronic Test Structures. 2022. 2022-March
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Jun Shiomi, Shogo Terada, Tohru Ishihara, Hidetoshi Onodera. Zero-Aware Fine-Grained Power Gating for Standard-Cell Memories in Voltage-Scaled Circuits. SOCC. 2022. 1-6
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Jun Shiomi, Shuya Kotsugi, Boyu Dong, Hidetoshi Onodera, Akihiko Shinya, Masaya Notomi. Tamper-Resistant Optical Logic Circuits Based on Integrated Nanophotonics. 2021 58th ACM/IEEE Design Automation Conference (DAC). 2021
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MISC (161件):
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有働, 岬, 村上, 健祐, イスラム, マーフズル, 小野寺, 秀俊. 電源電圧と基板電圧の動的調整がランダムテレグラフノイズに起因する遅延ばらつきに及ぼす影響. DAシンポジウム2020論文集. 2020. 2020. 65-71
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村上, 健祐, イスラム, マーフズル, 小野寺, 秀俊. 回路遅延の非線形モデルを用いたモンテカルロ法による遅延ばらつき解析. DAシンポジウム2020論文集. 2020. 2020. 59-64
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塩見 準, 石原 亨, 小野寺 秀俊, 新家 昭彦, 納富 雅也. 集積ナノフォトニクスに基づく近似並列乗算器を用いた低レイテンシ光ニューラルネットワーク-VLSI設計技術 ; デザインガイア2019 : VLSI設計の新しい大地. 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報. 2019. 119. 282. 127-132
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Shengyu Liu, Jun Shiomi, Tohru Ishihara, Hidetoshi Onodera. A Process-Scheduler-Based Approach to Minimum Energy Point Tracking. DA Symposium 2019 (poster). 2019
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福田 展和, 塩見 準, 石原 亨, 小野寺 秀俊. 幅広い動作環境にわたってLSIの最大遅延特性を追跡するクリティカルパスレプリカの構成法-A Method of Constructing a Replica Circuit Tracking Maximum Delay Characteristics of an LSI Circuit over a Wide Range of Operating Environments-VLSI設計技術. 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報. 2018. 118. 29. 25-30
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特許 (18件):
書籍 (5件):
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VLSI Design and Test for Systems Dependability, Shojiro Asai Ed.
Springer 2018
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情報処理学会論文誌「システムLSI設計とその技術」
情報処理学会論文誌 2007
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IEICE Transactions on Fundamentals, Special Section on VLSI Design and CAD Algorithms
IEICE Transactions on Fundamentals,E89-A,12 2006
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LSI配線の解析と合成 ---ディープサブミクロン世代のLSI設計技術---
培風館 2003
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IEICE Transaction on Fundamentals
SepcialSection on CAD,Vol.E84-A,No. 11 2001
講演・口頭発表等 (35件):
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Reconfigurable Architecture for Dependability and Energy Efficiency
(International Workshop on Cross-layer Resiliency 2019)
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Minimum Energy Operation of Voltage-Scaled Circuits
(International Workshop on Cross-layer Resiliency 2018)
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Toward minimum energy operation of voltage-scaled circuits
(IEEE/ACM 10th Workshop on Variability Modeling and Characterization 2017)
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Toward minimum energy operation
(International Workshop on Cross-Layer Resiliency 2017)
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Circuit Aging - Measurement Techniques
(IEEE International Reliability Physics Symposium, Monday Tutorial 2016)
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Works (10件):
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LSI製造ばらつきモデルを内蔵した統計解析回路シミュレータの研究開発
2005 -
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Optimal Design Methodology under Substrate Biasing
2005 -
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ばらつき考慮タイミング設計手法開発
2003 - 2004
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Variation-aware Timing Analysis Techniques
2003 - 2004
-
基板バイアス制御下での最適設計技術
2004 -
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学歴 (4件):
- - 1983 京都大学 工学研究科 電子工学
- - 1983 京都大学
- - 1978 京都大学 工学部 電子工学
- - 1978 京都大学
学位 (1件):
委員歴 (2件):
- 2001 - 2002 IEEE Solid-State Circuits Society,Kansai Chapter,Chairman
- 2000 - 2001 電子情報通信学会 VLSI設計技術研究専門委員会委員長
受賞 (1件):
所属学会 (4件):
ACM
, IEEE
, 情報処理学会
, 電子情報通信学会
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