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J-GLOBAL ID：200902226044504677   整理番号：08A0132631

オーバドライブ電圧とスルーイングを考慮したパイプライン化ADCの設計に対する性能モデル

A Performance Model for the Design of Pipelined ADCs with Consideration of Overdrive Voltage and Slewing

著者 (2件)： MIYAHARA Masaya (Tokyo Inst. of Technol., Tokyo, JPN) ,  MATSUZAWA Akira (Tokyo Inst. of Technol., Tokyo, JPN)
資料名： IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences (Institute of Electronics, Information and Communication Engineers)  (IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences (Institute of Electronics, Information and Communication Engineers))
巻： E91-A  号： 2  ページ： 469-475  発行年： 2008年02月01日 
JST資料番号： F0699C  ISSN： 0916-8508  資料種別： 逐次刊行物 (A)
記事区分： 原著論文  発行国： 日本 (JPN)  言語： 英語 (EN)

抄録/ポイント： 本論文は,パイプライン化アナログディジタル変換器(ADC)の...

シソーラス用語： *信号変換器 ,...
準シソーラス用語： *性能予測 ,...

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分類 (1件)： AD・DA変換回路  (NC05080M)

引用文献 (6件)：

• LEWIS, S. H. A 10-b, 20-Msample/s analog-to-digital converter. IEEE J. Solid-State Circuits. 1992, 27, 3, 351-358
• MATSUZAWA, A. Design challenges of analog-to-digital converters in nanoscale CMOS. IEICE Trans. Electron., C. 2007, E90, 4, 779-785
• YOSHIOKA, M. A 0.8 V 10b 80 MS/s 6.5mW pipelined ADC with regulated overdrive voltage biasing. IEEE ISSCC 2007, Dig. of Tech. Papers, Feb. 2007, 452-453
• MIYAHARA, M. The effects of switch resistances on pipelined ADC performances and the optimization for the settling time. IEICE Trans. Electron., C. 2007, E90, 6, 1165-1171
• CHUANG, S.-Y. A digitally self-calibrating 14-bit 10-MHz CMOS pipelined A/D converter. IEEE J. Solid-State Circuits. 2002, 37, 6, 674-683

タイトルに関連する用語 (4件)： パイプライン ,  ADC ,  設計 ,  性能モデル