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J-GLOBAL ID:202102253094508774   整理番号:21A1578217

実機のサイドチャネル攻撃耐性評価を目的とした時間・周波数領域相関電力解析

Time-Frequency Domain Correlation Power Analysis for Side-Channel Attack Resistance Evaluation of Practical Modules
著者 (3件):
資料名:
巻: 121  号: 6(EMCJ2021 1-6)  ページ: 21-26 (WEB ONLY)  発行年: 2021年04月09日 
JST資料番号: U2030A  ISSN: 2432-6380  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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実機のサイドチャネル攻撃耐性を評価する際,漏洩源以外のノイズやジッタによって時間領域の相関電力解析(CPA)では相関係数が低下して偽陰性になる場合がある.このような悪条件下では,時間・周波数領域におけるCPAが有効であると考えた.今回,Arduino上に実装した未対策のAES暗号回路について,時間・周波数領域CPAの性能を調査した.その結果,悪条件下でも時間領域のCPAより高い相関係数が得られた.このことから,ジッタや低SNRが予測される実機のSCA耐性を評価する際には,時間・周波数領域CPAが適していることを確認した.(著者抄録)
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引用文献 (11件):
  • Kocher, P., Jaffe, J., Jun, B., “Differential power analysis”, CRYPTO'99. LNCS, 1666, pp.388-397, December 1999.
  • Messerges, T.S, “Using second-order power analysis to attack DPA resistant software”, CHES 2000, LNCS, vol. 1965, pp. 238-251, 2000.
  • Christophe Clavier, Jean-Sébastien Coron, and Nora Dabbous, “Differential Power Analysis in the Presence of Hardware Countermeasures”, CHES 2000, LNCS 1965, pp. 252-263, 2000.
  • Suresh Chari, Josyula R. Rao, and Pankaj Rohatgi, “Template attacks”, CHES 2002, LNCS, vol. 2523, pp. 12-28, 2002.
  • E. Brier, C. Clavier, and F. Olivier, “Correlation power analysis with a leakage model”, CHES 2004, LNCS, vol. 3156, pp16-29, 2004.
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