動的部分再構成を用いた高速パターン認識ハードウェア  顔画像認識を対象としたプロトタイプシステムの構築

KAWAI H.; YAMAGUCHI Y.; YASUNAGA M.; GLETTE K.; TORESSEN J.

文献

J-GLOBAL ID：200902278588269329 整理番号：09A0026997

動的部分再構成を用いた高速パターン認識ハードウェア顔画像認識を対象としたプロトタイプシステムの構築

An Adaptive Pattern Recognition hardware with On-chip Dynamic and Partial Reconfiguration

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資料名：
巻： 108 号： 300(RECONF2008 38-54) ページ： 63-68 発行年： 2008年11月10日
JST資料番号： S0532B ISSN： 0913-5685 資料種別：会議録 (C)
記事区分：原著論文発行国：日本 (JPN) 言語：英語 (EN)

本稿では,動的部分再構成を利用したパターン認識システムをFPGA(Field Programmable Gate Array)を用いて構築する。このシステムの特徴は認識処理を1クロックで行うことができる高速性,そして部分再構成を用いることによって回路を書き換え,常に最適な認識性能を保つことができる適応性である。部分再構成は動的に行われるため,再構成中もシステム全体の動作が止まることはない。また,再構成のために必要なコンフィギュレーションデータはシステム動作中にFPGA内のPowerPC Coreを用いて生成可能なため,パーソナルコンピュータなどの外部ツールを必要としない。提案するのシステムの評価実験を行うため,本研究では顔画像認識を行うプロトタイプシステムを開発する。実験では,最適な認識精度を保つための演算,コンフィギュレーションデータの生成,そして部分再構成を行うためにかかる時間は30秒未満で完了することを示し,本システムの有効性について評価を行う。(著者抄録)

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パターン認識 , 専用演算制御装置

引用文献 (7件)：

YASUNAGA, M. Image Recognition Hardware using FPGAs for Nano-Second Range Recognition Speed. The trans. of the institute of electronics, information and commuication engineers, in Japanese, D-II. 2001, J84, 10, 2280-2292
YASUNAGA, M. The Kernel-based Pattern Recognition System Designed by Genetic Algorithms. IEICE Transaction on Information and Systems, D. 2001, E84, 11, 1528-1539
YASUNAGA, M. Development of a Pattern Recognition Evolvable Hardware System : Its Application to the Sonar Spectrum Recogniton. The trans. of the institute of electronics, information and commuication engineers, in Japanese, D-I. 2003, J86, 1, 1-13
TUFTE, G. Biologically-inspired : A rule-based selfreconfiguration of a virtex chip. 4th International Conference on Computational Science 2004 (ICCS 2004). 2004, 1249-1256
HADDOW, P. Bridging the genotype-phenotype mapping for digital FPGAs. The 3rd NASA/DoDWorkshop on Evolvable Hardware, IEEE Computer Society 2001. 2001, 109-115

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