特許
J-GLOBAL ID:200903023932824332
コントローラ装置、画像形成装置、コンピュータプログラム及び記録媒体
発明者:
出願人/特許権者:
代理人 (2件):
武 顕次郎
, 橘 昭成
公報種別:公開公報
出願番号(国際出願番号):特願2003-133358
公開番号(公開出願番号):特開2004-334774
出願日: 2003年05月12日
公開日(公表日): 2004年11月25日
要約:
【課題】I/F回路を動作させなくても容易にアービタ回路の動作確認ができるようにする。【解決手段】複数のDMA回路101,102,103が共通のメモリをアクセスするコントローラ装置において、各DMA回路101,102,103が接続されているそれぞれのI/F回路301,302,303とは別に、共通起動信号により同時に各DMA回路101,102,103を起動する機能をもち、メモリアービタ回路400の動作を、各I/F回路301,302,303を動作させずに確認する共通DMA回路制御回路600を設けた。【選択図】 図1
請求項(抜粋):
複数のDMA回路が共通のメモリをアクセスするコントローラ装置において、
各DMA回路が接続されるインターフェイス回路と、
前記各DMA回路のアクセス要求を調停する調停回路と、
前記各DMA回路を同時に起動し、前記調停回路の動作を前記インターフェイス回路を介さずに確認する制御回路と、
を備えていることを特徴とするコントローラ装置。
IPC (4件):
G06F13/00
, B41J5/30
, G06F3/12
, G06F13/28
FI (4件):
G06F13/00 301T
, B41J5/30 Z
, G06F3/12 B
, G06F13/28 310A
Fターム (11件):
2C187AC07
, 2C187AD04
, 2C187CC03
, 2C187FD01
, 5B021AA01
, 5B021DD00
, 5B061BA03
, 5B061QQ05
, 5B083AA08
, 5B083BB06
, 5B083CC06
引用特許:
引用文献:
審査官引用 (2件)
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