特許
J-GLOBAL ID：200903054457245112

マッチドフィルタ及び通信システム

発明者：
芝 隆司

芝 隆司 について

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比企野 治

比企野 治 について

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保坂 憲生

保坂 憲生 について

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藤田 勇次

藤田 勇次 について


出願人/特許権者：
株式会社日立メディアエレクトロニクス

株式会社日立メディアエレクトロニクス について


代理人 (1件)： 武 顕次郎
公報種別：公開公報
出願番号（国際出願番号）：特願平11-196022
公開番号（公開出願番号）：特開2001-024472
出願日： 1999年07月09日
公開日（公表日）： 2001年01月26日
要約：
【要約】【課題】 チップサイズの増大、複雑化を来さず、実効的なインパルス応答時間を確保する構造を有するマッチドフィルタ及びそれを用いる通信システムを提供する。【解決手段】 弾性表面波基板2上には、第1段の入力すだれ状電極3及び出力すだれ状電極4と、第2段の出力すだれ状電極7及び入力すだれ状電極6とが配置されている。また、第1段と第2段は中間端子5で電気的に接続されている。入力信号は、入力端子1から入力され、中間端子5を経由し、出力端子8から出力整合信号として出力される。入力すだれ状電極3及び出力すだれ状電極7は、拡散信号からの整合信号変換が可能となるように、符号化(位相変調)、開口重み付けが施されている。
請求項（抜粋）：
第1段の入力すだれ状電極及び出力すだれ状電極と、第2段の入力すだれ状電極及び出力すだれ状電極とが中間端子で電気的に縦続接続されていることを特徴とするマッチドフィルタ。
IPC (2件)：
H03H 9/42 ,  H03H 9/64
FI (2件)：
H03H 9/42 ,  H03H 9/64 Z
Fターム (3件)：
5J097AA29 ,  5J097BB06 ,  5J097CC03
引用特許：
出願人引用 (4件)
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審査官引用 (3件)

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