特許

J-GLOBAL ID：201103060423899901

暗号回路

発明者： 岡田 壮一 ,  鳥居 直哉 ,  林 朋弘 ,  出口 千佳広 ,  藤原 由実
出願人/特許権者： 富士通株式会社
代理人 (3件)： 小野 由己男 ,  宮川 良夫 ,  稲積 朋子
公報種別：特許公報
出願番号（国際出願番号）：特願2001-195752
公開番号（公開出願番号）：特開2003-015522
特許番号：特許第3851115号
出願日： 2001年06月28日
公開日（公表日）： 2003年01月17日
請求項（抜粋）：

【請求項1】 暗号鍵から所定の処理ブロック長に対応するビット数の複数のRound Keyを生成し、入力データと前記Round Keyのうちの1つと排他的論理和演算を実行するEXOR演算部と、Byte Sub変換、Shift Row変換、Mix Column変換、Round Key加算を含むRound処理を複数回実行するRound処理部とを備えるラウンドファンクション部により入力データと前記Round Keyによる暗号化/復号化処理を前記処理ブロック長毎に実行する暗号回路であって、 前記Round処理部が、入力データを前記処理ブロック長よりも小さい実行ブロック長に分割する第1セレクタと、前記実行ブロック長毎に前記Round Keyの値を入力データに加算する第1Round Key加算回路と、前記第1Round Key加算回路の出力を一時的に格納するとともに前記処理ブロック長によるShift Row変換を実行する中間レジスタ兼Shift Row変換回路と、前記中間レジスタ兼Shift Row変換回路の値が前記実行ブロック長毎に入力されByte Sub変換を実行するByte Sub変換回路と、前記中間レジスタ兼Shift Row変換回路の値が前記実行ブロック長毎に入力され前記Round Keyの値を前記実行ブロック長毎に加算する第2Round Key加算回路と、前記第2Round Key加算回路の出力に対してMix Column変換を実行するMix Column変換回路と、前記第1セレクタ、中間レジスタ兼Shift Row変換回路、Byte Sub変換回路、Mix Column変換回路の出力のうちいずれか1つを前記第1Round Key加算回路に出力する第2セレクタとを備えることを特徴とする暗号回路。

IPC (2件)：

G09C 1/00 ( 200 6.01) ,  H04L 9/06 ( 200 6.01)

FI (2件)：

G09C 1/00 610 A ,  H04L 9/00 611 Z

引用特許：

出願人引用 (1件)

• DPAに対して安全な暗号化
  公報種別：公開公報   出願番号：特願2001-178407   出願人：富士通株式会社