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J-GLOBAL ID：201502270760341033   整理番号：15A0285216

Time Analog to Digital Converterの線形性向上法

Proposal of a Method to Improve Linearity of Time Analog to Digital Converter

著者 (7件)： 林賢志 (横浜国立大学) ,  鈴木亮 (横浜国立大学) ,  渡辺高元 ((株)デンソー) ,  山内重徳 ((株)デンソー) ,  田口信幸 ((株)デンソー) ,  増田純夫 (横浜国立大学) ,  足立武彦 (横浜国立大学)
資料名： 電気学会論文誌 C  (IEEJ Transactions on Electronics, Information and Systems)
巻： 135  号： 1  ページ： 35-36 (J-STAGE)  発行年： 2015年 
JST資料番号： S0810A  ISSN： 0385-4221  資料種別： 逐次刊行物 (A)
記事区分： 短報  発行国： 日本 (JPN)  言語： 日本語 (JA)

抄録/ポイント： A/D変換器の高分解能化や低電源電圧化などに伴い,アナログ電圧を周波数・時間に変換してデジタル変換するTDC方式に関する研究開発が活発化している。TDC方式の1つとしてリングディレイライン(RDL)を用いたTime Amlog to Digital Convener(TAD)が提案されている。本論文では,電流制御RDLを用いてTADの線形性を向上する方法について検討した。そして,電流制御RDLを用いた線形性向上の効果を調べた。電流制御RDLは,インバータの上下に電流源を接続したものである。0.8μmプロセスを用いて回路を設計し,A/D変換特性のシミュレーションを行った。その結果,基本型TADと比較して,線形性の向上が確認できた。

シソーラス用語： *AD変換器 ,  *線形性 ,  *遅延線 ,  点
準シソーラス用語： *リングディレイライン ,  TDC【電子回路】 ,  TDA

分類 (1件)： AD・DA変換回路  (NC05080M)

引用文献 (5件)：

• (1) T. Watanabe, T. Mizuno, and Y. Makino : “An all-digital analog-to-digital converter with 12 mV/LSB using moving-average filtering”, IEEE J. Solid-State Circuits, Vol. 38, No. 1, pp. 120-125 (2003)
• (2) T. Kuroda and T. Sakurai : “Overview of low-power ULSI circuit techniques”, IEICE Trans. Electron., Vol. E78-C, No. 4, pp. 334-344 (1995)
• (3) R. Suzuki, T. Watanabe, N. Taguchi, S. Yamauchi, T. Terasawa, S. Masuda, and T. Adachi : “Linearity improvement of time to digital converter (TAD) made using current-controlled ring delay line”, Pap. Tech. Meet. Electon. Circuit, IEE Jpn., ECT-12-089 (2012)
• 鈴木・渡辺・田口・山内・寺澤・増田・足立:「電流制御リングディレイライン(RDL)を用いた時間分解能型AD変換器(TAD)の線形性の改善」, 電学電子回路研資, ECT-12-089 (2012)
• (4) R. J. Baker, H. W. Li, and D. E. Boyce : “CMOS circuit design layout, and simulation”, IEEE Press Series on Microelectronic Systems, John Wiley & Sons. Inc. (2002)

タイトルに関連する用語 (1件)： 線形性