測定に基づく確率的タイミング解析のための適合プロセッサアーキテクチャ【Powered by NICT】

Kosmidis Leonidas; Kosmidis Leonidas; Quinones Eduardo; Abella Jaume; Vardanega Tullio; Hernandez Carles; Gianarro Andrea; Broster Ian; Cazorla Francisco J.; Cazorla Francisco J.

文献

J-GLOBAL ID：201702238866020710 整理番号：17A0401675

測定に基づく確率的タイミング解析のための適合プロセッサアーキテクチャ【Powered by NICT】

Fitting processor architectures for measurement-based probabilistic timing analysis

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資料名：
巻： 47 号： PB ページ： 287-302 発行年： 2016年
JST資料番号： H0781A ISSN： 0141-9331 資料種別：逐次刊行物 (A)
記事区分：原著論文発行国：オランダ (NLD) 言語：英語 (EN)

比肩可能な性能/費用比のためのプレス市場需要が豊富なハードウェアを使用する臨界実時間組込みシステム産業強要。ハードウェアの複雑さにおけるその後の上昇はソフトウェアプログラムに必要とされ,特に完全性の最高レベルでプログラムに応用されている,も硬い課題の最悪実行時間(WCET)解析を行った。最新のWCET解析技術を,信頼性のある最悪ケース挙動を伴う進行プロセッサの内部操作と測定観測から得られたデータの困難の正確な知識を得るための高騰コストと複雑さによって妨げられている。フラストレートしている難問は,新しい解を必要とし,開発業務に低侵襲性であった。測定ベース確率的タイミング解析(MBPTA)技術を,信頼性のあるWCET限界を計算するための必要な知識を獲得するコストを同時に減少させると測定観測の代表性の増加の信頼性を得るために機会を提供する。MBPTA要求を満足させるための高速特徴の設計における必要な変化-現代のプロセッサで使用される超-述べた。Copyright 2017 Elsevier B.V., Amsterdam. All rights reserved. Translated from English into Japanese by JST.【Powered by NICT】

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ディジタル計算機ハードウェア一般 , 汎用演算制御装置 , 半導体集積回路 , 専用演算制御装置

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