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J-GLOBAL ID:201702290925720197   整理番号:17A1002993

BRein Memory:バイナリ・インメモリ再構成型深層ニューラルネットワークアクセラレータ

著者 (11件):
資料名:
巻: 117  号: 166(SDM2017 31-49)  ページ: 101-106  発行年: 2017年07月24日 
JST資料番号: S0532B  ISSN: 0913-5685  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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ニューラルネットワークの応用が興隆を見せている。しかしその発展に伴って計算量とデータ量も増大を続け,携帯機器等の電力の限られた環境での応用が制限される。本アーキテクチャは二値化ニューラルネットワークを採用し,全データをオンチップメモリに収めつつ,全演算をメモリ直近の並列計算で完結することで,処理時間と電力効率双方の改善を行う。またニューラルネットワークの計算の対称性を活用し,層の幅・数・形状に対するスケーラビリティとリコンフィギャラビリティを確保する。(著者抄録)
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分類 (1件):
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人工知能 
引用文献 (18件):
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