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J-GLOBAL ID:201802229298417242   整理番号:18A1680647

CMOS集積化スケーラブルプロセス技術における新しい512 ・320チップ傾斜マイクロミラーアレイ【JST・京大機械翻訳】

Novel 512 ・ 320 Tip-Tilt Micro Mirror Array in a CMOS-Integrated, Scalable Process Technology
著者 (17件):
資料名:
巻: 2018  号: OMN  ページ: 1-2  発行年: 2018年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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48μm画素サイズの2軸チップ傾斜アクチュエータから成る新しい512x320マイクロミラーアレイを開発し,任意方向に3.5°までの連続的,純粋なチップ傾斜運動を可能にし,0.025°より良い標準偏差で完全に較正できた。この素子は,基礎となる集積アドレス回路を用いた完全CMOS互換プロセスで実現した。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (1件):
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図形・画像処理一般 
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