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J-GLOBAL ID:201802230918703013   整理番号:18A1520338

フォールトツリー解析によるオンチップ配線における深刻な故障事象の調査

Survey of critical failure events in on-chip interconnect by fault tree analysis
著者 (2件):
資料名:
巻: 57  号: 7S2  ページ: 07MG01.1-07MG01.7  発行年: 2018年07月 
JST資料番号: G0520B  ISSN: 0021-4922  CODEN: JJAPB6  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: イギリス (GBR)  言語: 英語 (EN)
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分類 (1件):
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固体デバイス計測・試験・信頼性 
引用文献 (37件):
  • C. A. Ericson, II, Proc. 17th System Safety Conf., 1999.
  • M. Modarres, M. P. Kaminskiy, and V. Krivtsov, Reliability Engineering and Risk Analysis (CRC Press, New York, 2017) 3rd ed., p. 185.
  • E. Calixto, Gas and Oil Reliability Engineering (Gulf Professional Publishing, Cambridge, U.K., 2016) 2nd ed., p. 572.
  • C. Carlson, Effective FMEAs: Achieving Safe, Reliable, and Economical Products and Processes using Failure Mode and Effects Analysis (Wiley, New York, 2012) 1st ed., Chap. 3.
  • A. Bobbio, L. Portinale, M. Minichino, and E. Ciancamerla, Reliab. Eng. Syst. Saf. 71, 249 (2001).
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