NUMAを意識した実行アプローチによるキャッシュコヒーレンストラフィックの低減【JST・京大機械翻訳】

Caheny Paul; Alvarez Lluc; Derradji Said; Valero Mateo; Moreto Miquel; Casas Marc

文献

J-GLOBAL ID：201802260465117812 整理番号：18A0822189

NUMAを意識した実行アプローチによるキャッシュコヒーレンストラフィックの低減【JST・京大機械翻訳】

Reducing Cache Coherence Traffic with a NUMA-Aware Runtime Approach

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資料名：
巻： 29 号： 5 ページ： 1174-1187 発行年： 2018年
JST資料番号： T0882A ISSN： 1045-9219 CODEN： ITDSEO 資料種別：逐次刊行物 (A)
記事区分：原著論文発行国：アメリカ合衆国 (USA) 言語：英語 (EN)

キャッシュコヒーレントNUMA(ccNUMA)アーキテクチャは,コアカウントとメモリ容量をスケーリングするために提供する利点により,広範なパラダイムである。また,フラットメモリアドレス空間は,プログラム可能性を大幅に改善する。しかしながら,ccNUMAアーキテクチャは,並列実行の間に正確さを強化するために,洗練された高価なキャッシュコヒーレンスプロトコルを必要とし,システムにおけるオンおよびオフチップトラフィックのかなりの量を引き起こす。本論文では,結合ハードウェア/ソフトウェアアプローチの使用により,288コアから構成される大規模で実際のccNUMAプラットフォームにおいて,コヒーレンストラフィックが最良に制約される可能性を分析した。いくつかのベンチマークに対して,追加ハードウェアの最も効率的な利用を行うために,実行時間管理NUMAアウェアスケジューリングおよびデータ割当技術と組み合わせたディレクトリプロトコルにおける追加階層的キャッシュ層の影響下でのコヒーレンストラフィックを詳細に研究した。この共同アプローチの有効性を,NUMA-obliviousスケジューリングとデータ割当と比較して,3.14xから9.97xへのスピードアップと99%までのコヒーレンストラフィック低減により実証した。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【JST・京大機械翻訳】

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ディジタル計算機方式一般 , 計算機網

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