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J-GLOBAL ID:201802264855778983   整理番号:18A1045061

ランダムサンプリング技術による図式レベルでのアナログ故障シミュレーション自動化【JST・京大機械翻訳】

Analog fault simulation automation at schematic level with random sampling techniques
著者 (6件):
資料名:
巻: 2018  号: DTIS  ページ: 1-4  発行年: 2018年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文は,故障注入による試験の下での回路の高い故障被覆率を有するランダム故障選択に基づくアナログ故障効果シミュレーション自動化のための方式を提示して,先進的サンプリング技術に基づくシミュレーションを示した。ランダム故障選択は,信頼レベルで回路における異なる電気部品の故障発生の可能性を利用する。故障確率の計算のために,異なるデバイスの欠陥モデルを解析した。実装したツールによる事例研究は,尤度計算と故障シミュレーションが効率的な故障効果シミュレーション自動化の手段を提供することを実証した。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (1件):
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固体デバイス計測・試験・信頼性 
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