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J-GLOBAL ID:201902263939486601   整理番号:19A0005722

ポストペタスケール時代に向けた演算加速機構・通信機構統合環境の研究開発

著者 (1件):
資料名:
巻: 2017  ページ: WEB ONLY  発行年: 2017年 
JST資料番号: U0272A  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
抄録/ポイント:
抄録/ポイント
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・本研究では,高性能並列計算における演算系と通信系をTCA(Tightly Coupled Accelerators)という概念の下で融合し,GPUを中心とするアクセラレータによる演算加速と,FPGAを用いたノード間直接通信ハードウェア及びソフトウェアを統合し,従来の枠組みを越えた新しい演算加速並列処理の形を示し,この概念に基づくハードウェア,システムソフトウェア,アプリケーションの開発を垂直統合的に実施。
・研究は担当分野ごとの4グループに分かれて実施したが,全てのグループが横断的に共同研究を行い,FPGAを中心とする次世代高性能並列演算加速計算に対する一つの方向性を示すことに貢献。
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分類 (2件):
分類
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計算機システム開発  ,  ディジタル計算機方式一般 
タイトルに関連する用語 (5件):
タイトルに関連する用語
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