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J-GLOBAL ID:201902266946550284   整理番号:19A0478807

ユニット内フィードバックによるリニアアレイの多重ループ対応手法

著者 (3件):
資料名:
巻: 118  号: 339(CPSY2018 36-43)(Web)  ページ: 33-38 (WEB ONLY)  発行年: 2018年11月28日 
JST資料番号: S0532B  ISSN: 0913-5685  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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近年,計算機の演算性能向上によりDeep Learning等機械学習アルゴリズムの性能が大きく向上している。実社会での活用のため,組み込み機器における機械学習アルゴリズム実装の需要はますます高まっている。しかし,機械学習アルゴリズムで広く利用されているGPGPUでは組み込み機器における制約を満たすことが困難である。我々は,プログラミング容易性を確保しつつ,電力効率と面積効率に長けた演算器とローカルメモリを備えるユニットを一次元に配置したリニアアレイIMAXを提案してきた。しかし,多重ループ実行時の起動オーバヘッドが課題であった。起動オーバヘッド削減のためには多重ループの一括実行と途中結果の更新が必要である。本稿では,IMAXの演算ユニット内にフィードバックパスを設け,多重ループ制御とローカルメモリのRead-Modify-Writeを可能とする改善を行い,FPGA SoCと大規模FPGAを用いたARMv8+IMAXプロトタイプを用いて評価を行った。その結果,プロトタイプシステム上の改良版IMAXで,従来版IMAXに比べて,行列積で4.28倍,畳み込み演算では5.38倍の実行性能を有することが明らかとなった。(著者抄録)
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分類 (1件):
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専用演算制御装置 
引用文献 (8件):
タイトルに関連する用語 (5件):
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