PET応用のためのFPGA-TDCに基づく時間インタリーブアナログ-ディジタル変換変調器の設計【JST・京大機械翻訳】

Ma Cong; Wang Wubin; Zhao Xiaokun; Yu Li; Wu Guocheng

プレプリント

J-GLOBAL ID：202202200400017755 整理番号：22P0024229

PET応用のためのFPGA-TDCに基づく時間インタリーブアナログ-ディジタル変換変調器の設計【JST・京大機械翻訳】

The design of a time-interleaved analog-digital conversion modulator based on FPGA-TDC for PET application

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発行年： 2022年01月06日プレプリントサーバーでの情報更新日： 2022年01月06日
JST資料番号： O7000B 資料種別：プレプリント
記事区分：プレプリント発行国：アメリカ合衆国 (USA) 言語：英語 (EN)

高分解能時間とエネルギー測定のための完全フィールドプログラマブルゲートアレイ(FPGA)ベースのディジタイザは,陽電子放出コンピュータ断層撮影(PET)検出器における読出しエレクトロニクスのための魅力的な低コストソリューションである。近年,FPGAベース時間ディジタル変換器(FPGA-TDC)は商用PETスキャナの時間測定に広く用いられている。しかし,エネルギー測定では,商用アナログディジタル変換器(ADC)に対する完全FPGAベース,大きなダイナミックレンジおよび高分解能代替に関する研究はほとんど報告されていない。著者らの以前の研究は,25Ms/s FPGA-TDCベースのフリーランニングADC(FPGA-ADC)を提示し,PET検出器のための読出しエレクトロニクスにそれを成功裏に使用した。本研究では,時間インタリーブ戦略により,50Ms/s FPGA-ADCを示した。2つのオフチップ抵抗器だけによって,A/D変換とエネルギー測定の両方がXilinx Kintex-7 FPGA上で達成される。したがって,この方法は,システム統合を改善する大きな利点を有する。初期性能試験も提示し,将来,PET用の新しいFPGAのみのフロントエンドディジタイザを開発する可能性を与えた。【JST・京大機械翻訳】

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AD・DA変換回路 , 半導体集積回路

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