半導体装置及びその製造方法

Inventor： ,
Applicant, Patent owner：
Agent (1)：鈴江武彦
Gazette classification：公開公報
Application number (International application number)：1995240337
Publication number (International publication number)：1996153880
Application date： Sep. 19, 1995
Publication date： Jun. 11, 1996
Summary：

【要約】【課題】 SOI型MOSFETにおける短チャネル効果等の微細化形状に伴う不具合を低減する。【解決手段】 p型半導体基板101上に絶縁膜であるシリコン酸化膜102が形成されている。このシリコン酸化膜102上には、p型の基板110に、所定の距離をおいてn+ 層のソース103と同じくn+ 層のドレイン104が設けられている。このソース103とドレイン104との間のチャネル部105上には、絶縁膜であるシリコン酸化膜106が形成され、更にこのシリコン酸化膜上にゲート電極107が形成される。p型の基板(SOI層)110に形成されるソース103及びドレイン104の下のp型半導体基板101に高濃度p型領域108,109をそれぞれ形成する。

Claim (excerpt)：

半導体基板上の絶縁膜上に形成された半導体層に所定距離だけ離間して設けられた一対の高濃度不純物ソース・ドレイン領域と、このソース・ドレイン領域に挟まれたチャネル領域上にゲート絶縁膜を介して形成されたゲート電極とを有するSOIMIS型半導体装置において、前記ゲート電極にしきい電圧を印加し、前記ソース・ドレイン領域間に動作電圧を印加した場合、前記半導体基板上の絶縁膜中の等電位線が前記チャネル領域の下の絶縁膜中で凹型であることを特徴とする半導体装置。

IPC (2)：

H01L 29/786 , H01L 21/336

FI (3)：

H01L 29/78 626 C , H01L 29/78 616 M , H01L 29/78 622

Patent cited by the Patent：

Cited by examiner (3)

特開平3-147372
半導体装置およびその製造方法
Gazette classification：公開公報 Application number：特願平3-281715 Applicant：富士通株式会社
半導体装置
Gazette classification：公開公報 Application number：特願平6-162316 Applicant：日本電気株式会社

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