同期型回路

Inventor： ,
Applicant, Patent owner：
Agent (1)：山口邦夫 (外1名)
Gazette classification：公開公報
Application number (International application number)：1993102486
Publication number (International publication number)：1994314970
Application date： Apr. 28, 1993
Publication date： Nov. 08, 1994
Summary：

【要約】【目的】クロックラインを伝送するクロック信号の信号遅延があっても、同位相のクロック信号を形成できるようにする。【構成】共通のクロックラインから導出されるクロック信号に基づいて回路素子を同期して動作させる同期型回路において、途中で折り返されている一対のクロックラインLa、Lbと、これら一対のクロックラインLa、Lbの折り返し点POから見て等距離にある一対のクロックラインLa、Lb上の任意の点から得られる位相の異なる2つのクロック信号(CLK1、CLK6)、(CLK2、CLK5)、(CLK3、CLK4)に基づいて、これら2つのクロック信号の中間の位相を有するクロック信号CLK0を発生する手段M1〜M3を備える。折り返し点POから等距離にある位相の異なる2つのクロック信号を用いているので、3つのクロック信号CLK0は全て同相となる。

Claim (excerpt)：

共通のクロックラインから導出されるクロック信号に基づいて回路素子を同期して動作させる同期型回路において、途中で折り返されている一対のクロックラインと、上記一対のクロックラインの折り返し点から見て等距離にある上記一対のクロックライン上の任意の点から得られる位相の異なる2つのクロック信号に基づいて、上記2つのクロック信号の中間の位相を有するクロック信号を発生する手段とを備えたことを特徴とする同期型回路。

IPC (4)：

H03L 7/00 , G06F 1/00 340 , G06F 13/42 350 , H03L 7/06

Patent cited by the Patent：

Cited by examiner (4)

並列計算機のクロツク系
Gazette classification：公開公報 Application number：特願平3-165532 Applicant：富士通株式会社
特開平4-205326
特開平3-142553

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