文献
J-GLOBAL ID：201602219269079397
整理番号：16A0213170
有限要素法係数行列生成プロセスのメニィコア環境における最適化
Optimization of matrix assembly process in FEM applications on manycore architectures
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資料名：
巻：
2015
号：
HPC-152
ページ：
VOL.2015-HPC-152,NO.12 (WEB ONLY)
発行年：
2015年12月09日
JST資料番号：
U0451A
資料種別：
会議録 (C)
記事区分：
短報
発行国：
日本 (JPN)
言語：
日本語 (JA)
抄録/ポイント：
抄録/ポイント
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有限要素法は偏微分方程式の数値解法として広く計算科学・工学分野で使用されている。係数行列生成プロセスは連立一次方程式求解と並んで時間を要するプロセスである。本研究では,Intel Xeon PhiおよびNVIDIA Tesla K40を対象としてそれぞれの特性を生かした最適化を実施した。本稿では最適化の詳細と性能評価結果について述べる。(著者抄録)
シソーラス用語：
シソーラス用語/準シソーラス用語
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