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J-GLOBAL ID:201802257092971574   整理番号:18A1860182

パワーサイクルのFEシミュレーションによる焼結/はんだ付チップ-オン-基板試料の相対寿命推定に及ぼすパルス長と温度スイングの影響【JST・京大機械翻訳】

Influence of the pulse length and temperature swing on the relative lifetime estimation for sintered/soldered chip-on-substrate samples via FE-simulation of power cycles
著者 (3件):
資料名:
巻: 88-90  ページ: 1183-1188  発行年: 2018年 
JST資料番号: C0530A  ISSN: 0026-2714  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: イギリス (GBR)  言語: 英語 (EN)
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パワーエレクトロニクスモジュールの寿命は,入力として加速試験結果を用いる解析モデルにより最もしばしば決定される。これらの寿命試験は,通常,負荷パルス長さ(いわゆるt_on時間)に対する実験的に導出された主に保存的な値を仮定しており,時間/資源消費の試行錯誤較正作業をもたらす。構成要素に及ぼす熱機械的応力の影響を調べるもう一つの方法は,上述の試験をシミュレートするために数値モデルを用いることである。本研究では,有限要素法および感度解析により,代表的な焼結/はんだ付チップオン基板試料の寿命に及ぼす温度スイングおよび負荷パルス長(t_on)の影響を解析した。Copyright 2018 Elsevier B.V., Amsterdam. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (1件):
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固体デバイス計測・試験・信頼性 

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