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J-GLOBAL ID:200903010645790210

半導体装置及びその製造方法

Inventor:
Applicant, Patent owner:
Agent (1): 前田 弘 (外2名)
Gazette classification:公開公報
Application number (International application number):1996280784
Publication number (International publication number):1997270445
Application date: Oct. 23, 1996
Publication date: Oct. 14, 1997
Summary:
【要約】【課題】 マイクロストリップ線路を有する基板にMBB実装で半導体チップを搭載してMFICを作製する際に、実装後の誘電体膜の変化を抑えマイクロストリップ線路の特性インピーダンスを設計通りの一様な状態にする。【解決手段】 ガラス等の基板100の上に、接地導体膜101と、ベンゾシクロブテン(BCB)膜からなる誘電体膜102と、配線導体膜103a〜103cと、が形成されている。高周波用トランジスタを有する半導体チップ108をフリップチップ接続する際に、バンプ106に加わる荷重によってBCB膜からなる誘電体膜102が変形するのを抑制するために、ダミーバンプを設けたり、バンプ106や基板又はチップ側の電極パッドの強度を小さくする。MBB実装後も誘電体膜の膜厚をほぼ一様に保ち、インピーダンスの乱れを低減することができる。
Claim (excerpt):
少なくとも一部に下地導体膜を有する基板と、上記下地導体膜の上に形成されベンゾシクロブテン(以下、BCBと略記する)膜からなる誘電体膜と、上記誘電体膜の上に形成された配線導体膜と、高周波トランジスタと該高周波トランジスタに接続される電極とを有し、上記基板上にフェースダウンで搭載された半導体チップと、上記電極と上記配線導体膜との間に介設され両者を接続するためのバンプとを備えるとともに、上記下地導体膜,誘電体膜及び配線導体膜によりマイクロストリップ線路が構成されていることを特徴とする半導体装置。
IPC (2):
H01L 21/60 321 ,  H01L 21/60 311
FI (2):
H01L 21/60 321 X ,  H01L 21/60 311 S
Patent cited by the Patent:
Cited by applicant (3)
  • 半導体装置
    Gazette classification:公開公報   Application number:特願平6-067127   Applicant:松下電器産業株式会社
  • 特開平4-229691
  • 多層配線基板
    Gazette classification:公開公報   Application number:特願平6-331145   Applicant:日本特殊陶業株式会社
Cited by examiner (3)
  • 半導体装置
    Gazette classification:公開公報   Application number:特願平6-067127   Applicant:松下電器産業株式会社
  • 特開平4-229691
  • 多層配線基板
    Gazette classification:公開公報   Application number:特願平6-331145   Applicant:日本特殊陶業株式会社

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