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J-GLOBAL ID:200903071985871574

プロセッサ

Inventor:
Applicant, Patent owner:
Agent (1): 橋爪 健
Gazette classification:公開公報
Application number (International application number):1999354203
Publication number (International publication number):2001175533
Application date: Dec. 14, 1999
Publication date: Jun. 29, 2001
Summary:
【要約】【課題】 効率の良いキャッシュプリフェッチ機構を提供する。【解決手段】 命令実行ユニット1は、命令キャッシュ2からprefetch命令を読み出して、プリフェッチ対象アドレスがプリフェッチ機構6及びデータキャッシュ3に伝えられる。キャッシュヒットの場合はプリフェッチ機構6及びデータキャッシュ3は何もせず命令処理を終了する。キャッシュミスの場合はプリフェッチ対象アドレスを一時的にプリフェッチ機構6に蓄えておき、命令実行ユニット1の動作とは独立にプリフェッチ機構6がバスインターフェース5を通して外部メモリからデータを読み出してデータキャッシュ3にデータを格納する。命令実行ユニット1はプリフェッチアドレスをプリフェッチ機構6に渡すだけで、キャッシュプリフェッチの処理を終了して次の命令の処理を開始する。
Claim (excerpt):
各命令で扱うデータを記憶するデータキャッシュと、外部とのインタフェースのためのバスインタフェースユニットと、キャッシュプリフェッチアドレスを保持し、前記バスインタフェースユニットを介して外部から該キャッシュプリフェッチアドレスのデータを読み出して前記データキャッシュに登録するプリフェッチ機構と、各命令に従い、前記データキャッシュに要求を出力して該命令を実行し、及び、キャッシュプリフェッチアドレスを前記プリフェッチ機構に出力する命令実行ユニットとを備えたプロセッサ。
IPC (2):
G06F 12/08 ,  G06F 9/38 310
FI (4):
G06F 12/08 D ,  G06F 12/08 C ,  G06F 12/08 Q ,  G06F 9/38 310 A
F-Term (9):
5B005JJ13 ,  5B005KK12 ,  5B005KK23 ,  5B005MM02 ,  5B005MM03 ,  5B005MM23 ,  5B005NN01 ,  5B005NN22 ,  5B013AA05
Patent cited by the Patent:
Cited by examiner (7)
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