Pat
J-GLOBAL ID:201103002743365280
半導体装置及びその作製方法
Inventor:
,
Applicant, Patent owner:
Gazette classification:公開公報
Application number (International application number):2010119111
Publication number (International publication number):2011009724
Application date: May. 25, 2010
Publication date: Jan. 13, 2011
Summary:
【課題】酸化物半導体層を用いた薄膜トランジスタにおいて、酸化物半導体層とソース電極層又はドレイン電極層との間のコンタクト抵抗を低減し、電気特性を安定させた薄膜トランジスタを提供する。また、該薄膜トランジスタの作製方法を提供する。【解決手段】酸化物半導体層を用いた薄膜トランジスタにおいて、酸化物半導体層の上に、酸化物半導体層より導電率の高いバッファ層を形成し、該バッファ層の上にソース電極層及びドレイン電極層を形成し、酸化物半導体層とソース電極層又はドレイン電極層とがバッファ層を介して電気的に接続されるように薄膜トランジスタを形成する。また、バッファ層に逆スパッタ処理及び窒素雰囲気下での熱処理を行うことにより、酸化物半導体層より導電率の高いバッファ層を形成する。【選択図】図3
Claim (excerpt):
ゲート電極層と、前記ゲート電極層上にゲート絶縁層と、前記ゲート絶縁層上に酸化物半導体層と、前記酸化物半導体層上に第1のバッファ層及び第2のバッファ層と、前記第1のバッファ層及び前記第2のバッファ層の上にソース電極層及びドレイン電極層とを有し、
前記第1のバッファ層及び前記第2のバッファ層は、前記酸化物半導体層より導電率が高く、逆スパッタ処理及び窒素雰囲気下での熱処理を行うことによって形成され、
前記酸化物半導体層と前記ソース電極層及び前記ドレイン電極層とは前記第1のバッファ層及び前記第2のバッファ層を介して電気的に接続することを特徴とする半導体装置。
IPC (8):
H01L 29/786
, H01L 21/336
, H01L 27/08
, H01L 27/088
, H01L 21/823
, G09F 9/30
, G02F 1/136
, H01L 51/50
FI (12):
H01L29/78 616K
, H01L29/78 616V
, H01L29/78 618B
, H01L29/78 627F
, H01L29/78 618C
, H01L29/78 618A
, H01L29/78 616U
, H01L27/08 331E
, H01L27/08 102D
, G09F9/30 338
, G02F1/1368
, H05B33/14 A
F-Term (161):
2H092JA26
, 2H092JA40
, 2H092JA47
, 2H092KA04
, 2H092KA05
, 2H092KA08
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, 2H092KB22
, 2H092MA05
, 2H092MA07
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, 2H092NA21
, 2H092PA06
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, 2H092QA13
, 2H092QA14
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, 3K107GG05
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, 5F110NN53
, 5F110NN54
, 5F110NN71
, 5F110NN72
, 5F110NN73
, 5F110NN78
, 5F110QQ02
, 5F110QQ09
Patent cited by the Patent: