研究者
J-GLOBAL ID：201401004158283445   更新日: 2024年10月07日

石原 亨

イシハラ トオル | Ishihara Tohru
所属機関・部署：
名古屋大学 情報学研究科

名古屋大学 情報学研究科 について


職名： 教授
研究分野 (1件)： 計算機システム
競争的資金等の研究課題 (14件)：
  • 2024 - 2029 光演算回路に基づく広帯域かつ超省エネルギー情報処理基盤の創出
  • 2020 - 2023 光と電子が密に融合する集積回路のアーキテクチャと設計技術
  • 2017 - 2020 フォトニクスとエレクトロニクスの融合による光コンピュータの構成法に関する研究
  • 2017 - 2020 IoT社会の実現を目指した次世代コンピューティング基盤の研究
  • 2016 - 2020 自律的に最小エネルギー動作を実現する集積回路設計技術
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論文 (158件)：
  • Takumi KOMORI, Yutaka MASUDA, Tohru ISHIHARA. Virtualizing DVFS for Energy Minimization of Embedded Dual-OS Platform. IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences. 2024. E107.A. 1. 3-15
  • T. -F. Chen, Y. Masuda, T. Ishihara. A Standard Cell Memory Based on 2T Gain Cell DRAM for Memory-Centric Accelerator Design. Proc. 36th IEEE International System-On-Chip Conference (SOCC). 2023
  • Jun Shiomi, Shogo Terada, Tohru Ishihara, Hidetoshi Onodera. Zero-Aware Fine-Grained Power Gating for Standard-Cell Memories in Voltage-Scaled Circuits. SOCC. 2022. 1-6
  • Takumi Komori, Yutaka Masuda, Tohru Ishihara. DVFS Virtualization for Energy Minimization of Mixed-Criticality Dual-OS Platforms. RTCSA. 2022. 128-137
  • Naoki Hattori, Yutaka Masuda, Tohru Ishihara, Akihiko Shinya, Masaya Notomi. Power-aware pruning for ultrafast, energy-efficient, and accurate optical neural network design. DAC. 2022. 1285-1290
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MISC (104件)：
  • 陸佳萱, 増田豊, 石原亨. 近似コンピューティング回路の設計最適化に向けた計算重要度評価技術. 情報処理学会研究報告(Web). 2021. 2021. SLDM-195
  • 熊谷僚太, 増田豊, 石原亨. ファジングと高位合成を用いた近似コンピューティング回路のタイミング検証手法. 情報処理学会研究報告(Web). 2021. 2021. SLDM-195
  • 本多佑成, 増田豊, 石原亨. 近似コンピューティング回路の品質検証を高速化するファジングテスト法. 情報処理学会研究報告(Web). 2021. 2021. SLDM-195
  • 小森工, 増田豊, 塩見準, 石原亨. タスクの平均応答時間を保証する近似最小エネルギー点追跡. 回路とシステムワークショップ論文集(CD-ROM). 2021. 34th
  • 富山 葉月, 増田 豊, 石原 亨. 遅延故障に起因する回路寿命分布の確率的高速推定手法-Stochastic fast estimation of timing error induced circuit lifetime distribution-VLSI設計技術. 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報. 2020. 119. 443. 113-118
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特許 (11件)：
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書籍 (3件)：
  • Multi-Processor System-on-Chip 1
    Wiley - ISTE 2021
  • ウェスト&ハリス CMOS VLSI回路設計 基礎編
    丸善出版 2014
  • Essential Issues in SOC Design: Designing Complex Systems-on-Chip
    Springer 2006
講演・口頭発表等 (10件)：
  • Near-Threshold Cache Architecture for Ultra-Low Energy Computing
    (International Forum on MPSoC for Software-defined Hardware 2019)
  • Minimum Energy Point Tracking Exploiting All-Digital On-Chip Sensors
    (International Forum on MPSoC for Software-defined Hardware 2018)
  • Minimum Energy Point Tracking for Self-Power IoT Processors
    (International Forum on MPSoC for Software-defined Hardware 2017)
  • Minimum Energy Point Tracking under a Wide Range of PVT Conditions
    (The 20th Workshop on Synthesis And System Integration of Mixed Information technologies (SASIMI 2016) 2016)
  • An Integrated Optical Parallel Adder: A First Step towards Light-Speed Data Path Operation
    (International Forum on MPSoC for Software-defined Hardware 2016)
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学歴 (3件)：
  • 1997 - 2000 九州大学 大学院システム情報科学研究科
  • 1995 - 1997 九州大学 大学院システム情報科学研究科
  • 1991 - 1995 九州大学 工学部 情報工学科
学位 (1件)：
  • 博士(工学) (九州大学)
経歴 (7件)：
  • 2018/10 - 現在 名古屋大学 大学院情報学研究科 教授
  • 2011/04 - 2018/09 京都大学 大学院情報学研究科 准教授
  • 2007/04 - 2011/03 九州大学 システムLSI研究センター 准教授
  • 2005/08 - 2007/03 九州大学 システムLSI研究センター 助教授
  • 2003/04 - 2005/07 米国富士通研究所 研究員
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受賞 (17件)：
  • 2021/10 - Workshop on Synthesis And System Integration of Mixed Information technologies (SASIMI) Outstanding Paper Award 【An Accuracy Reconfigurable Multiply-Accumulate Unit Based on Operand-Decomposed Mitchell’s Multiplier】
  • 2021/05 - 電子情報通信学会 論文賞 【Methods for Reducing Power and Area of BDD-Based Optical Logic Circuits】
  • 2018/05 - 電子情報通信学会 論文賞 【Analytical Stability Modeling for CMOS Latches in Low Voltage Operation】
  • 2016/09 - IEEE International System on Chip Conference (SOCC) Best Paper Award 【Minimum Energy Poing Tracking Using Combined Dynamic Voltage Scaling and Adative Body Biasing】
  • 2016/09 - 情報処理学会システムLSI設計技術研究会 優秀論文賞 【CMOS LSIにおけるエネルギー最小点追跡のための電源電圧としきい値電圧の動的調節指針】
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