研究者
J-GLOBAL ID:201601017293110100   更新日: 2024年02月07日

宮原 正也

ミヤハラ マサヤ | Miyahara Masaya
所属機関・部署:
職名: 准教授
研究分野 (1件): 電子デバイス、電子機器
競争的資金等の研究課題 (7件):
  • 2023 - 2028 大強度中間子ビームを用いたラムダ陽子散乱実験によって拓くバリオン間相互作用の研究
  • 2022 - 2025 高放射線環境下でFPGAを動作させるための集積回路の開発
  • 2020 - 2022 遮蔽不要な臨界近接監視システ ム用ダイヤモンド中性子検出器 の要素技術開発
  • 2019 - 2022 新素材タイミングデバイスを用いた基準クロック生成用集積回路の開発
  • 2016 - 2021 全知を目指すセンサ読み出し集積回路技術に関する研究
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論文 (96件):
MISC (73件):
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講演・口頭発表等 (78件):
  • 高輝度LHC-ATLAS 実験に向けたTGC検出器のタイミング調整用ASICの量産品検査システム構築
    (日本物理学会秋季大会 2020)
  • 高輝度LHC-ATLAS実験に向けた TGC検出器のタイミング調整用 ASIC量産品の性能評価
    (日本物理学会年次大会 2020)
  • 高輝度LHC-ATLAS 実験に向けたTGC 検出器の前段読み出し回路の開発
    (日本物理学会秋季大会 2019)
  • 検出器のスマート化を目指したネットワーク・アナログデジタルコンバータ(ADC-SiTCP)チップの開発
    (日本物理学会秋季大会 2019)
  • 荷電粒子検出器用ASICの性能評価
    (日本物理学会秋季大会 2019)
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学位 (1件):
  • 博士(工学) (東京工業大学)
委員歴 (7件):
  • 2019/07 - 現在 International Conference on Analog VLSI Circuits Program Committee
  • 2018/03 - 現在 TIA次世代エレクトロニクス研究アライアンス 実行委員
  • 2016/04 - 現在 電子情報通信学会 英文論文誌C編集委員
  • 2016 - 現在 電子情報通信学会 アナログ特集号編集委員
  • 2012/04 - 2017/11 IEEE Asian Solid State Circuits Conference, Program Committee
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受賞 (7件):
  • 2017 - IEEE Student Design Contest, Distinguished Design Award, IEEE A-SSCC 2017 A High-Speed DDFS MMIC with Frequency, Phase and Amplitude Modulations in 65nm CMOS
  • 2014 - IEEE ASP-DAC, Best Design Award A Dual-Loop injection-Locked PLL with All-Digital Background Calibration System for On-chip Clock Generation
  • 2013 - 電子情報通信学会 LSIとシステムのワークショップ 最優秀ポスター賞(一般部門) アナログ設計における人手レイアウト設計から自動レイアウト設計への変換方法
  • 2012 - 電子情報通信学会 集積回路研究会 若手研究会優秀ポスター賞 補間型パイプラインADCに用いる増幅器の精度向上の研究
  • 2011 - 電子情報通信学会 LSIとシステムのワークショップIEEE SSCS Kansai Chapter Academic Research Award A High Speed 400-pixels Readout LSI with 10-bit 10 MSps Pixel ADCs for Quasi-3D Particle Detectors
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所属学会 (2件):
IEEE ,  電子情報通信学会
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