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J-GLOBAL ID：200902291575945585   整理番号：07A0941487

ビット・ベクタを利用した選択的命令再発行機構

Selective Instruction Re-Issue Mechanism using Bit Vector

著者 (3件)： 嶋田創 (京大 大学院情報学研究科) ,  三輪忍 (京大 大学院法学研究科) ,  富田眞治 (京大 大学院情報学研究科)
資料名： 情報処理学会研究報告  (IPSJ SIG Technical Reports)
巻： 2007  号： 79(ARC-174)  ページ： 67-72  発行年： 2007年08月01日 
JST資料番号： Z0031B  ISSN： 0919-6072  資料種別： 逐次刊行物 (A)
記事区分： 原著論文  発行国： 日本 (JPN)  言語： 日本語 (JA)

抄録/ポイント： 将来のプロセッサでは,配線遅延の増大により,命令を発行してか...

シソーラス用語： *命令制御 ,...
準シソーラス用語： 投機的実行 ,...

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分類 (2件)： 制御方式  (JC02030K) ,  計算機システム開発  (JD02010R)

引用文献 (7件)：

• AGARWAL, V. Clock Rate versus IPC : The End of the Road for Conventional Microarchitectures. ISCA-28, 2001. 2001, 248-259
• KESSLER, R. The Alpha 21264 Microprocessor. IEEE Micro. 1999, 19, 2, 22-36
• HINTON, G. The Microarchitecture of the Pentium 4 Processor. Technical Report, Intel Terchnology Journal. 2001, 5, Issue 1
• 佐藤寿倫. 命令再発行機構によるデータアドレス予測に基づく投機実行の効果改善. 情報処理学会論文誌. 1999, 40, 5, 2093-2108
• 五島正裕. 行列に基づく Out-of-Order スケジューリング方式の評価. 情報処理学会論文誌 : ハイパフォーマンスコンピューティングシステム. 2002, 43, SIG 6(HPS 5, 13-23

タイトルに関連する用語 (4件)： ビット ,  ベクタ ,  命令 ,  発行