特許
J-GLOBAL ID：201803014944718156
ニューラルネットワーク回路装置、ニューラルネットワーク、ニューラルネットワーク処理方法およびニューラルネットワークの実行プログラム
発明者：
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出願人/特許権者：
代理人 (1件)：
特許業務法人磯野国際特許商標事務所
公報種別：公開公報
出願番号（国際出願番号）：特願2016-235383
公開番号（公開出願番号）：特開2018-092377
出願日： 2016年12月02日
公開日（公表日）： 2018年06月14日
要約：
【課題】バッチ正規化回路が不要なニューラルネットワーク回路装置、ニューラルネットワーク、ニューラルネットワーク処理方法およびニューラルネットワークの実行プログラムを提供する。【解決手段】2値化ニューラルネットワーク回路100は、入力値x1〜xn(xi)(2値)を入力する入力ノードおよび重みw1〜wn(wi)を入力する入力部101と、入力値x1〜xnおよび重みw1〜wnを受け取り、XNOR論理を取るXNORゲート回路102と、多ビットバイアスW’を入力する多ビットバイアスW’入力部110と、各XNOR論理値と多ビットバイアスW’との総和を取る総和回路103と、総和を取った信号Yに対して符号ビットのみを出力する活性化回路120と、を備える。【選択図】図9
請求項（抜粋）：
入力層、1以上の中間層、および、出力層を少なくとも含むニューラルネットワークにおいて、前記中間層の中で、入力値に重みづけとバイアスを乗算するニューラルネットワーク回路装置であって、
入力値xiおよび重みwiを受け取り、論理演算を行う論理回路部と、
多ビットバイアスW'を受け取り、前記論理回路部の出力と前記多ビットバイアスW'との総和を取る総和回路部と、
総和を取った多ビット信号Yに対して符号ビットのみを出力する活性化回路部と、を備える
ことを特徴とする記載のニューラルネットワーク回路装置。
IPC (1件)：
FI (1件)：
引用特許：
引用文献：
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