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J-GLOBAL ID:202002271464485151   整理番号:20A1414601

低抵抗GaAs/Siヘテロ界面を作製するための表面活性化による室温での化学結合【JST・京大機械翻訳】

Chemical bonding at room temperature via surface activation to fabricate low-resistance GaAs/Si heterointerfaces
著者 (8件):
資料名:
巻: 525  ページ: Null  発行年: 2020年 
JST資料番号: B0707B  ISSN: 0169-4332  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: オランダ (NLD)  言語: 英語 (EN)
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表面活性化結合(SAB)により作製したGaAs/Siヘテロ界面の室温(RT)における結合機構を,低温集束イオンビームおよび飛行時間二次イオン質量分析と組み合わせた断面走査透過電子顕微鏡を用いて調べた。RTでの接合過程において,おそらく表面活性化過程で導入された点欠陥によって支援された過渡的増強拡散による界面での原子混合が確認される。原子的に清浄で活性化した表面の形成と同様に,界面での欠陥支援原子拡散はSABの重要な概念であり,それによってRTで強靭なヘテロ界面を創製できる。一方,活性化表面の欠陥は界面抵抗を低下させる。劣化特性はSABプロセス後の適切なアニーリングによって回復できるが,ヘテロ界面の周りの原子構造はアニーリング中に修正される。SABとその後のアニーリング条件を制御することで,化学結合強度と電子特性の間のトレードオフ関係の最適化により低抵抗ヘテロ界面を得ることができ,結合前の活性化表面により決定した。Copyright 2020 Elsevier B.V., Amsterdam. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (2件):
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半導体薄膜  ,  半導体の表面構造 

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