特許
J-GLOBAL ID:201303088326067191
半導体装置とその製造方法
発明者:
,
,
,
,
,
出願人/特許権者:
,
代理人 (1件):
特許業務法人快友国際特許事務所
公報種別:公開公報
出願番号(国際出願番号):特願2013-018260
公開番号(公開出願番号):特開2013-123074
出願日: 2013年02月01日
公開日(公表日): 2013年06月20日
要約:
【課題】 ヘテロ構造を備えているとともにIII-V族化合物半導体で構成される半導体装置において、安定的なノーマリオフ動作を実現する。【解決手段】 p-GaN層32とSI-GaN層62とAlGaN層34が積層され、AlGaN層34の表面側にショットキー接続されているゲート電極44を備えている半導体装置である。p-GaN層32とSI-GaN層62よりもAlGaN層34のバンドギャップの方が大きく、さらに、SI-GaN層62は、その不純物濃度が1×1017cm-3以下であることを特徴としている。【選択図】 図1
請求項(抜粋):
第1層と中間層と第2層が積層され、第2層の表面側に電極が形成されている半導体装置であり、
第1層は、第1導電型の第1種類のIII-V族化合物半導体で構成されており、
中間層は、不純物濃度が1×1017cm-3以下の第1種類のIII-V族化合物半導体で構成されており、
第2層は、第1導電型以外の第2種類のIII-V族化合物半導体で構成されており、
第1種類のIII-V族化合物半導体のバンドギャップよりも第2種類のIII-V族化合物半導体のバンドギャップの方が大きいことを特徴とする半導体装置。
IPC (9件):
H01L 21/338
, H01L 29/778
, H01L 29/812
, H01L 21/337
, H01L 27/098
, H01L 29/808
, H01L 21/336
, H01L 29/78
, H01L 29/786
FI (4件):
H01L29/80 H
, H01L29/80 C
, H01L29/78 301B
, H01L29/78 618B
Fターム (50件):
5F102GB01
, 5F102GC01
, 5F102GD01
, 5F102GD04
, 5F102GD10
, 5F102GJ02
, 5F102GJ04
, 5F102GJ10
, 5F102GK04
, 5F102GL04
, 5F102GM04
, 5F102GQ01
, 5F102GS01
, 5F102GT01
, 5F110AA06
, 5F110CC01
, 5F110DD04
, 5F110DD12
, 5F110EE02
, 5F110EE14
, 5F110EE43
, 5F110FF02
, 5F110GG04
, 5F110GG12
, 5F110GG19
, 5F110GG25
, 5F110GG42
, 5F110HK02
, 5F110HK04
, 5F110HK21
, 5F110HK32
, 5F110HK42
, 5F110QQ14
, 5F140AA24
, 5F140AC36
, 5F140BA02
, 5F140BA06
, 5F140BA09
, 5F140BA16
, 5F140BB18
, 5F140BF05
, 5F140BF11
, 5F140BF15
, 5F140BG30
, 5F140BJ07
, 5F140BJ11
, 5F140BJ15
, 5F140BK29
, 5F140BK38
, 5F140CE02
引用特許:
審査官引用 (6件)
-
特開昭59-022367
-
特開平4-015929
-
半導体装置およびその製造方法
公報種別:公開公報
出願番号:特願2003-058021
出願人:三菱電機株式会社
全件表示
前のページに戻る