研究者
J-GLOBAL ID:200901024794597175
更新日: 2021年10月21日
関根 敏和
セキネ トシカズ | Toshikazu Sekine
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所属機関・部署:
岐阜大学 工学部
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研究分野 (2件):
通信工学
, 電子デバイス、電子機器
研究キーワード (8件):
シグナルインテグリティ
, マイクロ波伝送回路
, インターコネクト
, 分布定数回路
, signalintegrity
, microwave circuit
, interconnect
, distributed circuit
競争的資金等の研究課題 (4件):
不均一線路の解析及び合成
分布集中定数混在回路の設計
Analysis and Synthsis of Nonuniform Transmission Lines
Mixed Lumped and Distributed Circuits Design
MISC (109件):
Kazunari Kato, Yasuhiro Takahashi, Toshikazu Sekine. Two phase clocked subthreshold adiabatic logic circuit. IEICE ELECTRONICS EXPRESS. 2015. 12. 20
Cancio Monteiro, Yasuhiro Takahashi, Toshikazu Sekine. Low-power secure S-box circuit using charge-sharing symmetric adiabatic logic for advanced encryption standard hardware design. IET CIRCUITS DEVICES & SYSTEMS. 2015. 9. 5. 362-369
Kazunari Kato, Yasuhiro Takahashi, Toshikazu Sekine. A 4×4-bit multiplier LSI implementation of two phase clocking subthreshold adiabatic logic. Conference Proceedings - 13th IEEE International NEW Circuits and Systems Conference, NEWCAS 2015. 2015
Kazunari Kato, Yasuhiro Takahashi, Toshikazu Sekine. Skew tolerance analysis and layout design of 4×4 multiplier using two phase clocking subthreshold adiabatic logic. IEEE Asia-Pacific Conference on Circuits and Systems, Proceedings, APCCAS. 2015. 2015-. February. 495-498
Yasuhiro Takahashi, Toshikazu Sekine, Michio Yokoyama. SPICE model of memristive device using Tukey window function. IEICE ELECTRONICS EXPRESS. 2015. 12. 5
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特許 (5件):
差動論理によりサイドチャネル攻撃から保護される暗号回路
2相駆動CMOS断熱的論理回路
SRAMおよびその制御方法
2相駆動CMOS断熱的論理回路
圧力センサ素子
Works (2件):
不均一線路の時間領域解析及び合成
1999 - 2002
Time Domain Analysis and Synthsis of Nonuniform Transmission Lines
1999 - 2002
学歴 (4件):
- 2002 山形大学 理工学研究科 システム情報工学
- 2002 山形大学
- 1974 山形大学 工学部 電子
- 1974 山形大学
学位 (1件):
博士(工学) (山形大学)
経歴 (1件):
岐阜大学 工学部 電気電子工学科 情報システム講座 助教授
所属学会 (4件):
IEEE
, 電子情報通信学会
, IEICE
, IEEE
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